Memoria dinamica a accesso casuale dei circuiti integrati di IS41LV16100C-50TLI ISSIElectronic
1.FEATURES
• Input ed uscite compatibili di TTL; ingresso/uscita di tre stati
• Rinfreschi l'intervallo:
— L'auto del rinfresca il modo: spettrografia di massa di /16 di 1.024 cicli
— Solo RAS, CAS-prima di-RAS (CBR) e nascosto
— L'auto rinfresca il modo: spettrografia di massa di /128 di 1.024 cicli
• Piedinatura standard di JEDEC
• Singola alimentazione elettrica:
5V ± 10% (IS41C16100C)
3.3V ± 10% (IS41LV16100C)
• Il byte scrive ed il byte l'operazione di lettura via due CAS
• Gamma di temperature industriale: -40oC a +85oC
2.DESCRIPTION
TheISSIIS41C16100CandIS41LV16100Care1,048,576
accesso casuale dinamico ad alto rendimento di CMOS di 16 bit di x
Memorie. Questi dispositivi offrono un accesso del ciclo hanno chiamato
Di dati modo di pagina esteso fuori (EDO). EDO Page Mode
permette 1.024 accessi casuali all'interno di singola fila con
tempo di ciclo di accesso breve quanto 30 NS per parola di 16 bit. È
asincrono, poichè non richiede un input di segnale dell'orologio
per sincronizzare i comandi ed ingresso/uscita.
ThesefeaturesmaketheIS41C/41LV16100Cideallysuited
per gli alti grafici di larghezza di banda, elaborazione numerica dei segnali,
sistemi di computer a alto rendimento ed unità periferica
applicazioni cui funzioni senza un orologio per sincronizzare con
il DRAM.
Il IS41C/41LV16100C è imballato 42 in un pin 400 mil
SOJ e un perno da 400 mil 50/44 TSOP (tipo II)
PARAMETRI DI SINCRONIZZAZIONE 3.KEY
CONFIGURAZIONI 4.PIN 50(44) - Pin TSOP (tipo II)
SCHEMA A BLOCCHI 5.FUNCTIONAL
la descrizione 6.Functional Il IS41C/41LV16100C è un CMOS DRAM ottimizzato per la larghezza di banda ad alta velocità, le applicazioni di potere basso. Durante COLTO o SCRIVA i cicli, ogni pezzo unicamente è indirizzato attraverso i 16 pezzi di indirizzo. Questi sono inseriti dieci bit (A0-A9) a tempo. L'indirizzo di fila è chiuso dallo stroboscopio di indirizzo di fila (RAS). L'indirizzo di colonna è chiuso dallo stroboscopio di indirizzo della colonna (CAS). RAS è usato per chiudere i primi nove bit e CAS è usato per chiudere i nove bit posteriori. Il IS41C/41LV16100C ha due comandi di CAS, LCAS e UCA. Gli input degli UCA e di LCAS internamente genera un segnale di CAS che funziona in un modo identico al singolo input di CAS sugli altri 1M x 16 DRAM. La differenza chiave è che ogni CAS controlla la sua logica di tre stati corrispondente dell'ingresso/uscita (insieme con OE e NOI e RAS). Comandi i O0 di LCAS con i comandi I/O8 degli UCA e di I/O7 con I/O15. La funzione di IS41C/41LV16100C CAS è determinata dal primo MINIMO transitioning di CAS (LCAS o UCA) e dall'ultimo LIVELLO posteriore transitioning. I due comandi di CAS danno il IS41C16100C ed il BYTE di IS41LV16100C sia COLTO che il BYTE SCRIVONO le capacità del ciclo. Il ciclo di memoria del ciclo di memoria A è iniziato da per portare RAS IN BASSO ed è terminato restituendo sia RAS che il LIVELLO di CAS. A si accerta dell'operazione adeguata del dispositivo e l'integrità dei dati tutto il ciclo di memoria, onceinitiated, mustnotbeendedoraborted prima del tempo minimo di tras ha espirato. Un nuovo ciclo non deve essere iniziato fino al trp minimo di tempo di precarica, tcp è trascorso. Il ciclo di lettura del ciclo di lettura A è iniziato dal bordo di caduta di CAS o OE, l'ultimo dei whicheveroccurs, indirizzo di whileholdingWEHIGH.Thecolumn deve essere tenuto per un tempo minimo specificato da catrame. I dati fuori diventano validi soltanto quando il trac, il taa, il tcac e il toea tutto sono soddisfatti. Di conseguenza, il tempo di accesso dipende dalle relazioni della sincronizzazione fra questi parametri. Scriva il ciclo A scrivono il ciclo è iniziato dal bordo di caduta di CAS e dei NOI, qualunque accade l'ultima volta. I dati di input devono essere validi a o beforethefallingedgeofCASorWE, whicheveroccursfirst. L'auto rinfresca il ciclo per conservare i dati, 1.024 rinfresca i cicli è richiesta in ciascuno un periodo di 16 spettrografie di massa. Ci sono due modi rinfrescare la memoria. 1. Cronometrando ciascuno dei 1.024 indirizzi di fila (A0 con A9) con RAS almeno una volta che ogni massimo tref. Tutta la colta, scrive, leggere-modifica-writeorRAS-onlycyclerefreshestheaddressed la fila. 2. Facendo uso della a CAS-prima di-RAS rinfreschi il ciclo. ThefallingedgeofRAS di CAS-beforeRASrefreshisactivatedby, mentre tenendo CAS IN BASSO. In CAS-prima di-RAS rinfreschi 9 interni cyclean il contatore del bit che fornisce gli indirizzi di fila e gli input esterni di indirizzo sono trascurati. CAS-prima di-RAS è un modo solo e nessun accesso ai dati o selezione del dispositivo è permesso. Quindi, l'uscita rimane nello stato alto--z durante il ciclo. L'auto rinfresca il ciclo che l'auto rinfresca permette l'utente una dinamica rinfresca, il modo della conservazione di dati all'esteso rinfresca un periodo di spettrografia di massa 128 cioè, 125 µs per fila quando facendo uso di CBR distribuito rinfresca. La caratteristica inoltre concede all'utente la scelta completamente di uno statico, il modo della conservazione di dati di potere basso. L'auto facoltativo rinfresca la caratteristica è iniziato eseguendo un CBR rinfresca il ciclo e la tenuta del MINIMO di RAS per il tRAS specificato. L'auto rinfresca il modo è terminato determinando il LIVELLO di RAS per un tempo minimo del ritardo di tRP.This tiene conto il completamento di tutto l'interno rinfresca i cicli che possono essere in lavorazione ai tempi della transizione Basso ALTA di RAS. Se il regolatore di DRAM usa distribuito rinfreschi la sequenza, uno scoppio rinfrescano non è richiesto sopra l'uscita dell'auto rinfrescano. Tuttavia, il iftheDRAMcontrollerutilizesaRAS-onlyorburst rinfresca la sequenza, tutte e 1.024 le file deve essere rinfrescato all'interno dell'interno medio la velocità di rinfrescamento, prima della ripresa dell'operazione normale. I dati estesi verso l'esterno l'operazione del modo di pagina di EDO del modo di pagina permettono tutte e 1.024 le colonne all'interno di una fila selezionata di essere raggiunti a caso ad un alto tasso di dati. Nel ciclo di lettura del modo di pagina di EDO, i dati-fuori sono tenuti al bordo di caduta del ciclo seguente di CAS, invece del bordo in aumento. Per questo motivo, il tempo valido del emissione dei dati nel modo di pagina di EDO è esteso rispetto al modo di pagina veloce. Nel modo di pagina veloce, il tempo valido del emissione dei dati diventa per quanto il tempo di ciclo di CAS diventi più breve più breve. Di conseguenza, nel modo di pagina di EDO, il margine cronometrante nel ciclo di lettura è più grande di quello del modo di pagina veloce anche se il tempo di ciclo di CAS diventa più breve. Nel modo di pagina di EDO, dovuto la funzione estesa di dati, il tempo di ciclo di CAS può essere più breve di nel modo di pagina veloce se il margine cronometrante è lo stesso. TheEDOpagemodeallowsbothreadandwriteoperations durante l'un ciclo di RAS, ma la prestazione è equivalenti a quello del modo di pagina veloce in quel caso. Acceso durante acceso, RAS, gli UCA, LCAS e NOI deve interamente seguire con Vdd (LIVELLO) per evitare gli impulsi correnti e che permettono che l'inizializzazione continui. Una pausa iniziale di 200 µs è richiesta seguita da un minimo di otto cicli di inizializzazione (qualsiasi combinazione di cicli che contengono un segnale di RAS).
Q1. Che cosa è i vostri termini di imballaggio?
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